商品の詳細:
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チャネルの数:: | 1RX、1TX | 周波数範囲:: | 0-6GHz |
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帯域幅:: | 20MHZまで | 特徴:: | 高い帯域幅、高動的範囲 |
FPGA:: | Xilinxスパルタ式3A-DSP 3400 FPGA | DAC:: | 16ビット- 400 MS/s |
ハイライト: | 無線のdefinidaソフトウェアN210,無線のdefinidaソフトウェアN210 Ettus,n210 ettusの高いダイナミック レンジ |
普遍的なソフトウェア ラジオ周辺USRP-LW N210
プロダクト概観
USRP-LW N210は高い帯域幅、高動的範囲の工程能力を提供する。USRP-LW N210はこのタイプの急速な開発を要求する要求のコミュニケーション アプリケーションのために意図されている。プロダクト建築は上位演算処理装置に出入してデータを流すためにXilinxスパルタ式3A-DSP 3400 FPGA、100 MS/s二重ADC、400 MS/s二重DACおよびギガビットのイーサネット結合性を含んでいる。
主な特長:
1. 最高の伝送速度:50MS/s
2. ギガビットのイーサネット関係
3. USRP-LW N210のそうMIMOの構造ごとの1つの単一のトランシーバー リンクだけで関係ベースのMIMOケーブルは2つ以上のUSRP-LW N210sによって造られなければならない
4. FPGAの処理の上
5.FPGA:Xilinxスパルタ式XC3SD3400A
6. ADCs:14ビット100 MS/s
7. DACs:16ビット- 400 MS/s
8. 外的な5つか10のMHzの参照クロックを締める能力
9. 任意内部GPSのサーボ時計– USRP-LW N210 GPSDO
図式的な図表
詳しい性能:
モジュール設計は拡張の港は多数USRP-LW N210シリーズ装置がMIMO構成で合わせられ、使用されるようにするがUSRP-LW N210がDCから6つのGHzに作動するようにする。また任意GPSDOモジュールが世界的なGPSの標準の0.01 PPM内のにUSRP-LW N210の参照クロックを訓練するのに使用することができる。USRP-LW N210はホストの塗布に出入して50までMS/sを流すことができる。ユーザーはFPGAの生地、またはsoftcore機内32ビットRISCの注文機能を実行できる。USRP-LW N210は付加的な論理、記憶およびDSP資源を要求する適用にUSRP-LW N200より大きいFPGAを提供する。FPGAはまたの方向を送受信するために100までMS/sを処理する潜在性を提供する。FPGAファームウェアはギガビットのイーサネット インターフェイスを通して再積載することができる。
技術的な変数:
変数部門 | 数値 | 単位 | 変数部門 | 数値 | 単位 |
入出力 | WBX-LWと組み合わせられた場合RFのパフォーマンス パラメータ | ||||
DC電圧の入力 | 6 | V | Single-sideband信号/イメージの拒絶 | 35/50 | dBc |
現在 | 1.3 | 段階の騒音(1.8GHz)。 | |||
WBXのドーター・ボードを取付けた場合現在 | 2.3 | 10kHz | -80 | dBc/Hz | |
改宗者モジュール変数 | 100つのkHz | -100 | dBc/Hz | ||
ADCのサンプリング レート | 100 | MS/s | 1MHz | -137 | dBc/Hz |
ADCの決断 | 14 | ビット | 出力電力 | 15 | dBm |
ADC SFDR | 88 | dBc | 第三次の妨害ポイントを書き入れなさい | 0 | dBm |
DACのサンプリング レート | 400 | MS/s | 雑音指数 | 5 | dB |
DACの決断 | 16 | ビット | 物理的性質 | ||
DAC SFDR | 80 | dBc | 実用温度 | 0-55 | C |
ホストの最大レート(8b/16b)を使って。 | 50/25 | MS/s | サイズ | 225×165×50 | mm |
ローカル振動正確さ | 2.5 | PPM | 重量 | 1.0 | kg |
ロックGPSDOの精密 | 0.01 | PPM |
この装置に含まれている:
1. USRP-LW N210
2. 2つのSMA隔壁ケーブル
3. 1ギガビットのイーサネット ケーブル
より詳しい情報を必要としたら私に連絡することを躊躇してはいけない。
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コンタクトパーソン: Mr. Chen
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